Coreco PCVisionplus Quick user guide

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Coreco Imaging, Inc.
PCVisionplus[
Hardware
Reference Manual
402-00005-00
Revision 02
February 8, 2002
Artisan Technology Group - Quality Instrumentation ... Guaranteed | (888) 88-SOURCE | www.artisantg.com

PCVisionplusHardware
Reference Manual
Document Number 402-00005-00
Revision 02; February 8, 2002
CopyrightCoreco Imaging, Inc 2002–2001
Copyrighttransferred to Coreco Imaging, Inc 2000
CopyrightImaging Technology Incorporated 2000
All rights reserved.
Printed in the United States of America.
All copyrights in this manual, and the hardware and software described in it, are the exclusive property of Coreco Imaging, Inc and its licensors.
Claim of copyright does not imply waiver of Coreco Imaging, Inc.’s or its licensor’s other rights in the work. See the following Notice of Propri-
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hibited except with the express written consent of Coreco Imaging, Inc.
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ing, Inc. assumes no responsibility for errors or omissions in this document.
PC-LineScan, PC-DIG, PC-RGB, PC-COMP, PCVision, IFC-SDK, Sherlock, SMART Search and the Coreco
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SherlockPro, MVTools, ITEX, Prophecy and PCVisionplus are Registered Trademarks of Coreco Imaging, Inc.
All other trademarks are the property of their respective owners.
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http://www.imaging.com
Headquarters
7075 Place Robert-Joncas, Suite 142
St. Laurent, Quebec, Canada H4M 2Z2
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U.S. Office
900 Middlesex Turnpike, Bld 8, 2nd floor
Billerica, MA, USA 01821
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PCVisionplusHardware Reference
iiiRev 02; February 8, 2002
PREFACE
The PCVisionplus frame grabber captures images from analog monochrome cameras at frequencies up to 53 MHz.
The PCVisionplus provides interface to a host computer through the PCI-bus.
•Chapter 1, “Overview” introduces the PCVisionplus and provides operating specifications.
•Chapter 2, “Theory of Operation” describes the operation of the PCVisionplus.
•Chapter 3, “Registers” provides detailed descriptions of every register and bit that controls the PCVisionplus.
•Chapter 4, “DAC and PLL Programming” provides detailed descriptions of the serial interfaces and program-
ming examples for PLL and XTAL modes.
•Appendix A, “Connectors and Cables” gives the pin-out of the connectors, and illustrates some of the cables cur-
rently available for the PCVisionplus.
•Appendix B, “Using Opto-Isolators” gives some examples of using the opto-isolated trigger input, and connect-
ing an opto-isolator to the PCVisionplus outputs.
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402-00005-00Preface
iv Rev 02; February 8, 2002
DOCUMENTATION CONVENTIONS
The following conventions are used throughout this manual:
Example Description
CAUTION A caution calls attention to a hazard to the equipment or software; a condition, practice, or
procedure that must be observed to avoid damage to or destruction of equipment.
NOTE A note calls attention to essential information of special importance, interest, or assistance in
operation.
X When used within a table, this notation indicates an irrelevant bit value, also called a “don’t
care”.
R/W The bit or register supports both read and write access.
R-O The bit or register supports read access only.
W-O The bit or register supports write access only.
0x3F0,
03F0H Hexadecimal numbers are preceded by 0x or followed by H.
0110B Binary numbers are followed by a B.
lsb, msb Least significant bit, most significant bit. The use of lower case letters means bits.
LSB, MSB Least significant byte, most significant byte. The use of capitals letters means bytes.
DWORD A 32-bit address or data value.
WORD A 16-bit address or data value.
BYTE An 8-bit address or data value.
LEN Line Enable: digital signal that corresponds to horizontal timing signal on analog video, and
HDRIVE in some digital cameras. When LEN is true or active, it corresponds to the active
line time, and pixel data is valid. When LEN is disabled or false, it corresponds to the hori-
zontal reset or horizontal blank timing.
FEN Frame Enable: digital signal that corresponds to vertical timing signal on analog video, and
VDRIVE in some digital cameras. When FEN is true or active, it corresponds to the active
frame time, and pixel data is valid. When FEN is disabled or false, it corresponds to the verti-
cal reset or vertical blank timing.
PLL Phase-Locked Loop.
PTG Programmable Timing Generator
PWG Programmable Window Generator
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Preface
PCVisionplusHardware Reference
vRev 02; February 8, 2002
Table of Contents
Chapter 1. Overview
1.1 PCI Interface 1–1. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2 PCVisionplus Specifications 1–2. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.1 PCVisionplus Video Inputs 1–2. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.2 PCVisionplus Timing Inputs (Standard Video) 1–2. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.3 Variable Scan Timing Inputs 1–2. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.4 PCVisionplus Trigger Inputs 1–4. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.5 PCVisionplus Timing Outputs 1–4. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.6 Image Memory 1–5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.7 Output Scatter Gather Table 1–5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.8 Output Control Table 1–5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.9 Host Access 1–6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.10 Bus Master Transfer 1–6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.11 Parallel I/O Port 1–6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.12 Environmental 1–7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.2.13 Camera Power 1–7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Chapter 2. Theory of Operation
2.1 Overview 2–1. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2 Host Interface 2–1. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.1 Memory Access 2–1. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.2 Register Access 2–2. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.2.1 PCI Configuration Registers 2–2. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.2.2 PCI Interface Control Registers 2–3. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.2.3 Board ID Registers 2–3. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.2.4 Acquisition Module Control Registers 2–3. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.2.5 Frame Buffer Control Registers 2–3. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.3 PCI-bus Interrupts 2–3. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.3.1 Master/Target Abort Interrupts 2–4. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.3.2 Bus Master Transfer Interrupts 2–4. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2.3.3 Acquisition Interrupts 2–4. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.3 Image Memory 2–5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.3.1 Image Acquisition 2–5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.3.1.1 Normal Acquisition 2–5. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.3.1.2 External Trigger Acquisition 2–6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
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402-00005-00Preface
vi Rev 02; February 8, 2002
2.3.1.3 Multiple Frame Acquire Mode 2–6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4 Bus Master Operation 2–7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.1 Scatter Gather 2–7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.2 Scatter Gather Table 2–8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.3 Output Control Table 2–8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.4 Output Formatting 2–8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.4.1 Region of Interest 2–8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.4.2 Zoom and Decimate 2–8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.4.3 Padding 2–11. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.4.4 Clipping 2–12. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.4.5 Bus Master Data Shift 2–13. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.5 Bus Master Latency 2–13. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5 Camera Interface 2–14. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.1 Input MUX 2–14. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.2 Gain 2–14. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.3 Low-Pass Filters 2–15. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.4 DC Restoration 2–16. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.4.1 Sync Stripper Clamp Pulse 2–16. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.4.2 Programmable Clamp Pulse 2–16. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.5 Programmable Clamp Voltage DAC 2–17. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.6 Analog to Digital Converter 2–17. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.7 Programmable References 2–17. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.8 Input LUT 2–18. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.6 Timing and Synchronization 2–20. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.6.1 Sync Stripper PLL Mode 2–20. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.6.2 Separate Sync PLL mode 2–21. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.6.3 Internal Clock Mode (XTAL Mode) 2–22. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.6.4 Variable Scan Mode (VSCAN) 2–23. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7 Timing Control 2–24. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.1 Variable Scan Inputs 2–24. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.2 Sync Stripper 2–25. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.3 Phase-Locked Loop 2–26. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.4 Programmable Time Base Generator (PTG) 2–27. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.5 Programmable Window Generator (PWG) 2–29. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.5.1 PWG in PLL Mode 2–29. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.5.2 PWG in XTAL Mode 2–31. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.5.3 PWG in Variable Scan Mode 2–31. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.5.4 PWG Vertical Timing 2–32. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
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Preface
PCVisionplusHardware Reference
viiRev 02; February 8, 2002
2.7.6 Field Shift Mode 2–33. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.7 External Trigger and Strobe 2–34. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.7.1 Using Strobe Lights 2–34. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.7.2 Back To Back Trigger 2–36. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.7.3 Stored Trigger 2–36. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.7.4 Skip Field Mode 2–36. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.7.5 Trigger on Frame-Slow Strobe Mode 2–36. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.7.6 Trigger on Frame-Fast Strobe Mode 2–37. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7.7.7 Frame Reset Mode 2–38. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Chapter 3. Registers
3.1 PCI Configuration Registers 3–6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.1 Vendor Identification (VID) R-O 3–6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.2 Device Identification (DID) R-O 3–6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.3 PCI Command (PCICMD) R/W 3–7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.3.1 I/O Space Enable (IOEN) R/W 3–7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.3.2 Memory Space Enable (MEMEN) R/W 3–7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.3.3 Bus Master Enable (PCIBMEN) R/W 3–8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.3.4 Parity Error Enable (PAREN) R/W 3–8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.3.5 System Error Enable (SEREN) R/W 3–8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.3.6 Fast Back-to-Back Transfer Enable (FBB) R/W 3–8. . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.4 PCI Status (PCISTAT) R/W1C 3–9. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.4.1 Data Parity Reported (DTPAR) R/W1C 3–9. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.4.2 Signaled Target Abort (STABT) R/W1C 3–9. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.4.3 Received Target Abort (RTABT) R/W1C 3–10. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.4.4 Received Master Abort (RMABT) R/W1C 3–10. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.4.5 Signaled System Error (SSERR) R/W1C 3–10. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.4.6 Detected Parity Error (DPARE) R/W1C 3–10. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.5 Revision Identification (RID) R-O 3–11. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.5.1 Revision Field (REVID) R-O 3–11. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.6 Class Code (CLCD) R-O 3–11. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.7 Cache Line Size (CALN) R-O 3–11. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.8 Latency Timer (LAT) R/W 3–11. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.9 Header Type (HDR) R-O 3–12. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.10 Built-In Self-Test (BIST) R-O 3–12. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.11 Base Address Zero (BADR0) R-O 3–12. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.12 Base Address One (BADR1) R-O 3–13. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.13 Base Address Two (BADR2) R-O 3–13. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.14 Base Address Three (BADR3) R-O 3–14. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Artisan Technology Group - Quality Instrumentation ... Guaranteed | (888) 88-SOURCE | www.artisantg.com

402-00005-00Preface
viii Rev 02; February 8, 2002
3.1.15 Base Address Four (BADR4) R-O 3–14. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.16 Base Address Five (BADR5) 3–15. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.17 Expansion ROM Base Address (XROM) R-O 3–15. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.18 Interrupt Line (INTLN) R/W 3–15. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.19 Interrupt Pin (INTPIN) R-O 3–16. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.20 Minimum Grant (MINGNT) R-O 3–16. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.21 Maximum Latency (MAXLAT) R-O 3–16. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2 PCI Interface Control Registers 3–17. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.1 Mailbox Registers (MBOX1, MBOX2, MBOX3, MBOX4) R/W 3–17. . . . . . . . . . . . . . . . .
3.2.2 Bus Master Destination Address (BMDST) R-O 3–18. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.3 Bus Master Transfer Count (BMXC) R-O 3–18. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.4 PCI Interrupt Control and Status (INTCTL) R/W 3–19. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.4.1 PCI Interrupt Enable (INTEN) R/W 3–19. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.4.2 Interrupt on Bus Master Transfer Done (BINTEN) R/W 3–20. . . . . . . . . . . . . . . . . . .
3.2.4.3 PCI Interrupt Status (INTST) R/W1C 3–20. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.4.4 Bus Master Interrupt Status (BINTST) R/W1C 3–20. . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.4.5 Master Abort Interrupt Status (MAINT) R/W1C 3–20. . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.4.6 Target Abort Interrupt Status (TAINT) R/W1C 3–20. . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.5 Bus Master Host Control/Status (BMCTL) R/W 3–21. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.5.1 FIFO Full (FIFOFL) R-O 3–21. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.5.2 FIFO 4 Plus (FIFO4P) R-O 3–21. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.5.3 FIFO Empty (FIFOEM) R-O 3–22. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.5.4 Bus Master Done (BMDONE) R-O 3–22. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.5.5 Software Reset (RST) R/W 3–22. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3 Board ID Registers 3–23. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3.1 Board Status (BRDSTAT) R-O 3–23. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3.1.1 Build Status (BLDSTAT) R-O 3–24. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3.1.2 FPGA Loading Done (FPGADONE) R-O 3–24. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3.1.3 FPGA Ready Status (FPGARDY) R-O 3–24. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3.1.4 PIO Level Jumper Setting (PIOLSTAT) R-O 3–24. . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3.1.5 Expansion Module Present (CMPRESENT) R-O 3–24. . . . . . . . . . . . . . . . . . . . . . . . .
3.3.1.6 Revision (REV) R-O 3–24. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3.2 FPGA Programming (ORCAPRGM) R/W 3–25. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3.3 FPGA Reset (ORCARST) W-O 3–25. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4 Acquisition Module Control Registers 3–26. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.1 PTG Horizontal 1 (PTGH1) R/W 3–27. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.1.1 Horizontal Sync Pixel Count Total (HTOTAL) R/W 3–27. . . . . . . . . . . . . . . . . . . . . . .
3.4.1.2 Horizontal Sync End (HESYNC) R/W 3–28. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Artisan Technology Group - Quality Instrumentation ... Guaranteed | (888) 88-SOURCE | www.artisantg.com

Preface
PCVisionplusHardware Reference
ixRev 02; February 8, 2002
3.4.1.3 Horizontal Sync Output Polarity (HSYNCPOL) R/W 3–28. . . . . . . . . . . . . . . . . . . . . .
3.4.1.4 Internal Timing Horizontal Sync Polarity (XTALMDHPOL) R/W 3–28. . . . . . . . . . .
3.4.2 PTG Vertical 1 (PTGV1) R/W 3–29. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.2.1 Vertical Sync Total (VTOTAL) R/W 3–29. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.2.2 Vertical Sync Low Time (VSEND) R/W 3–30. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.2.3 Vertical Sync Polarity (VSYNCPOL) R/W 3–30. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.2.4 E-Donpisha Mode Enable (EDONP) R/W 3–30. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.2.5 Vertical Error Status (VERROR) R-O 3–31. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.3 PTG Vertical 2 (PTGV2) R/W 3–31. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.3.1 Vertical Gate Start (VGSTRT) R/W 3–31. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.3.2 Vertical Gate End (VGEND) R/W 3–32. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.4 PWG Horizontal (PWGH) R/W 3–33. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.4.1 Horizontal Offset (HOFF) R/W 3–34. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.4.2 Horizontal Active (HACT) R/W 3–34. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.5 PWG Vertical (PWGV) R/W 3–35. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.5.1 Vertical Offset (VOFF) R/W 3–35. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.5.2 Vertical Active (VACT) R/W 3–36. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.5.3 15-Pin TTL Trigger 0 Status (EXTRIGSTAT0_15) R-O 3–36. . . . . . . . . . . . . . . . . . . .
3.4.5.4 TTL Trigger 1 Status (EXTRIGSTAT1) R-O 3–36. . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.5.5 15-Pin TTL Trigger 0 Status (EXTRIGSTAT0_15) R-O 3–37. . . . . . . . . . . . . . . . . . . .
3.4.5.6 Opto-Isolator Trigger 0 Status (OPTOSTAT0) R-O 3–37. . . . . . . . . . . . . . . . . . . . . . .
3.4.5.7 Opto-Isolator Trigger 1 Status (OPTOSTAT1) R-O 3–37. . . . . . . . . . . . . . . . . . . . . . .
3.4.5.8 Differential Trigger 0 Status (DIFFSTAT0) R-O 3–37. . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.5.9 Differential Trigger 1 Status (DIFFSTAT1) R-O 3–37. . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6 Input Control 1 (INCON1) R/W 3–38. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.1 Trigger Enable (TRIGEN) R/W 3–39. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.2 Trigger Source Select (TRIGSEL) R/W 3–39. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.3 Trigger Polarity Select (TRIGPOL) R/W 3–39. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.4 Trigger Cycle Status (TRIGCYC) R-O 3–40. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.5 Skip Field Mode (SKPFLDMD) R/W 3–40. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.6 WEN Mode (WENMD) R/W 3–40. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.7 Strobe Mode Select (STRBMD) R/W 3–40. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.8 Strobe Polarity Select (STRBPOL) R/W 3–40. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.9 Strobe Output Enable (STRBEN) R/W 3–41. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.10 Strobe Delay (STRBDLY) R/W 3–41. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.11 Frame Reset Mode Select (FRSTMD) R/W 3–41. . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.12 Frame Reset Polarity Select (FRSTPOL) R/W 3–42. . . . . . . . . . . . . . . . . . . . . . . . . .
3.4.6.13 Frame Reset Size (FRSTSZ) R/W 3–42. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
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